Um serviço de controle de acesso em ambientes de Grades computacionais coerente deve combinar múltiplas políticas, permitindo com que administradores, sítios e usuários determinem regras e mecanismos para proteger seus recursos. Esse trabalho propõe uma plataforma de controle de acesso flexível para aplicações Java em ambientes de grade computacional, que permite o gerenciamento, efetivação e integração de múltiplas políticas e mecanismos de segurança. No intuito de demonstrar as capacidades do sistema proposto foi realizado um teste operacional para gerenciar e efetivar de forma integrada duas políticas: uma que integra o controle de acesso a um sistema IDS local e outra focada no princípio de privilegio mínimo.
A universidade brasileira ressente-se sem duvida de um equipamento de maior porte que atenue não só suas necessidades de processamento científico, mas também que seja uma máquina aberta que permita aos grupos de informática o acesso a circuitaria e a logicionaria de baixo nível, possibilitando deste modo uma ampla gama de facilidades em pesquisas e desenvolvimentos, não facilmente disponíveis em outros sistemas. Através do MP-LSI 8701 é proposta uma organização e a arquitetura de sistema que além de versátil apresente um baixo custo de implementação, acessível portanto a grande parte das universidades brasileiras.
This report describes a proposed architecture for a massively parallel, shared memory computer, using commercially available microprocessors (DEC Alphas). The architecture is scalable from 4 processors to 65536 processors. Each processor has a peak performance of 200Mflops, and therefore this proposed architecture allows us to build systems with peak performance greater than 10 Tflops. Four processors are organized as a tightly coupled multiprocessing cluster. Multiple clusters (up to 8) can share a host, and multiple hosts can be used to build larger systems. Clusters communicate by means of a scalable interconnection network, that allows processors from one cluster to access the memory in a different cluster, thus providing a single memory space. Coherent caches are used to both reduce and hide the latency of inter-cluster communication.
Tecnologias emergentes de comunicação ponto-a-ponto de alta velocidade, como o ATM, o SCI e o FibreChannel, abrem novos horizontes na implementação de sistemas de computação de alto desempenho. O SCI é um padrão ANSI/IEEE que provê recursos para a implementação de coerência de cache entre nós de processamento, permitindo a construção de multiprocessadores CC-NUMA com base em estações de trabalho. O SCI vem sendo estudado como opção para a interconexão de nós de processamento dentro do projeto SPADE, ora em desenvolvimento no LSI-EPUSP. Neste trabalho são feitas simulações do SPADE-1 com topologias anel e hierarquias de anéis baseadas em ligações de 125 MBytes/s, que representam a tecnologia hoje disponivel de produtos SCI a nivel comercial. Em particular, é investigado o impacto do controle de fluxo e tamanho de filas em sistemas com interconexão SCI.
O IDXP usa o formato IDMEF e propõe autenticação dos parceiros de comunicação, integridade e confidencialidade por meio do protocolo BEEP. O objetivo do trabalho é propor a integração do IDMEF com um modelo XML de assinatura digital de conteúdo, denominada variante IDMEF, proporcionando segurança da mensagem com o uso de qualquer protocolo de comunicação. Como resultado, o artigo discute uma análise comparativa entre o protocolo IDXP e a variante proposta.
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