Power/Area Tradeoffs in 1-of-M Parallel-Prefix Asynchronous Adders

Fragoso, J.; Sicard, Gilles; Renaudin, Marc

doi:10.1007/978-3-540-39762-5_19

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“…Pour l'obtention de tels résultats, plusieurs additionneurs ont été générés (différentes bases et nombre de digits) et chaque additionneur a été évalué avec le modèle proposé. Les résultats ont été normalisés par rapport à l'additionneur double rail équivalent (Fragoso et al, 2003).…”

Section: Comparaison D'architecturesunclassified

Estimation rapide du couple énergie/délai des circuits asynchrones QDI

Fragoso

Sicard

Renaudin

2007

Techniques et sciences informatiques

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Ce papier propose une méthode d'estimation rapide de la consommation et de la latence des circuits asynchrones QDI (« quasi-delay insensentive »). Les résultats de consommation et de délai peuvent être combinés dans une métrique Et n pour permettre de comparer plusieurs implémentations logiques asynchrones d'une même fonctionnalité. Ainsi, des transformations peuvent être appliquées aux différentes implémentations et la nouvelle consommation et le nouveau délai peuvent facilement être recalculés. De cette façon, il est possible de tester la sensibilité de chaque implémentation aux transformations envisageables. ABSTRACT. This paper proposes a fast estimation method for energy and latency of QDI (quasi delay-insensitive) asynchronous circuits. The energy and latency results can be combined into an Et n metric for allowing comparison between different asynchronous implementations. Furthermore, each implementation can be transformed and new values of energy and latency can be quickly and easily recalculated. In this way, it is possible to determine the sensitivity of an implementation to a given transformation.

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Section: Comparaison D'architecturesunclassified